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LABORATORIO DE SISTEMAS DIGITALES I 1

Laboratorio de Sistemas Digitales I

Asignatura: Laboratorio de Sistemas Digitales I Profesor: Vivar Recarte, Amador Tema: Cartas ASM/Diagrama de flujo Integrantes:

8 de Junio 2006

Montes Castro, Wagner Condori Quispe, Reene Rivera Córdova, Cristian Aragón Chávez, Carlos Inciso Flores, Jorge

PROBLEMAS DE MODELO DE COLAS

FACULTAD DE INGENIERÍA DE TELECOMUNICACIONES--UNFV

LABORATORIO DE SISTEMAS DIGITALES I 2

PRÁCTICA #1

INTRODUCCIÓN: A CONTINUACION DAREMOS UNA BREVE EXPLICACION DEL INFORME, SE BASA EN LA TRANSFERENCIA DE DATOS DE FORMA BIDIRECCIONAL UTILIZANDO MULTIPLEXORES, MEMORIAS, DECODIFICADORES, ENTRE OTROS. PERO LO MAS IMPORTANTE EN ESTE PROYECTO ES LA IMPLEMENTACION POR MEDIO DE DIAGRAMAS DE FLUJO-CARTAS ASM EN REMPLAZO DE DIAGRAMAS DE ESTADO.

OBJETIVO PRINCIPAL: ES LLEVAR ACABO LA TRANSFERENCIA DE DATOS DE MANERA BIDIRECCIONAL.

MATERIALES: • • • • • • • • • • •

MEMORIA EPROM 27C256 CI 74194 CI 74157 CI 74174 CI 7404 CI 7448 RESISTORES 1K RESISTORES 120 OHMIOS DISPLAY CATADO COMUN SWITCH FUENTE DC 5V

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LABORATORIO DE SISTEMAS DIGITALES I 3

DATASHEET DE CI

MEMORIA EPROM

MUX

INVERSOR

REGISTRO BIDIRECCIONAL

HEX D TYPE FFPP

DECODER 7SEG CAT COMUN

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LABORATORIO DE SISTEMAS DIGITALES I 4

DIAGRAMA DE FLUJO 000

A LOAD A=0

RESET A=1 MA=X

LOAD B=0

RESET B=1 MB=X

1

RESET

001

0 LOAD A=0

RESET A=1 MA=X

LOAD B=0

RESET B=1 MB=X

1

RESET

010

0 LOAD A=0

RESET A=1 MA=X

LOAD B=0

RESET B=1 MB=X

1

RESET

0 0

A

1

0

B

SET

1

B

A

1 RESET

RESET

0

0

SET

1

0

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SET

1

LABORATORIO DE SISTEMAS DIGITALES I 5

RESET

CARGA

PUSO DE RELOJ

OPERACIÓN DE A > B

OPERACIÓN DE B > A

0

1

10

11

100

LOAD(A)=0

LOAD(A)=0

LOAD(A)=1

LOAD(A)=0

LOAD(A)=1

LOAD(B)=0

LOAD(B)=0

LOAD(B)=1

LOAD(B)=1

LOAD(B)=0

RESET(A)=1

RESET(A)=0

RESET(A)=0

RESET(A)=0

RESET(A)=0

RESET(B)=1

RESET(B)=0

RESET(B)=0

RESET(B)=0

RESET(B)=0

MA=*

MA=0

MA=0

MA=0

MA=1

MB=*

MB=1

MB=1

MB=0

MB=1

S=*

S=*

S=*

S=0

S=1

R=1

R=0

R=0

R=0

R=0

TABLA DE DIAGRAMA DE FLUJO

TABLA DE DIAGRAMA ASM

E P

ES

LOAD(A)

LOAD(B)

RESET(A)

RESET(B)

MA

MB

0 1 1 1 0 1 1 1 0 1 1 1 0 1 0 1 0 1

0 1 1 1 0 1

0 1 1 1 0 1

0 1 1 1 0 1

0 1 1 1 0 1

A B B A A 0 0 0 0 0 0 0 0

0 0 1 1

0 0 1 1

0 0 * *

1 1 * *

B C C A A 1 1 0 0 1 1 0 0

0 0 1 1

0 0 1 1

0 0 * *

1 1 * *

C D D A A 0 0 0 0 1 1 0 0

0 0 1 1

0 0 1 1

0 0 * *

0 0 * *

D D E A A 0 1 0 0 1 0 0 0

0 0 1 1

0 0 1 1

0 1 * *

0 1 * *

E D E A A 0 1 0 0 1 0 0 0

0 0 1 1

0 0 1 1

0 1 * *

0 1 * *

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LABORATORIO DE SISTEMAS DIGITALES I 6

TABLA DE TRANSICION ENTRADAS

SALIDAS

R

DIRECCIONES S Q2 Q1 Q3

0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 1 1 1

0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 0 0 0 0 0 0 0 0 1 1 1

0 0 0 0 1 1 1 1 0 0 0 0 1 1 1 1 0 0 0 0 1 1 1 1 0 0 0

0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1 1 0 0 1

1 1

0

1 1

CONTENIDO DE MEMORIA RA RB LOAD(A) LOAD(B) MA MB

Q1´

Q0´

0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0

Q2 ´ 0 0 0 0 0 0 0 0 0 0 0 1 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0 1 1 1 1 0 0 0 0 1 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

1 0 1 1 1 0 0 0 1 0 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0 0 0 0 0 1 1 1 0 0 0 0 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1

0 0 0 0 0 1 1 1 0 0 0 0 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1

0 1 0 0 0 0 0 0 0 1 0 1 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0 1 1 1 1 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0

0 0 0 0 0 * * * 0 0 0 1 1 * * * * * * * * * * * * * *

1 1 0 0 * * * * * * * * * * * * * * * * * * * * * * *

041 08D 0C4 0C4 0C4 030 030 030 041 08D 0C4 10B 10B 030 030 030 030 030 030 030 030 030 030 030 030 030 030

1

1

0

0

0

1

1

0

0

*

*

030

1

0

0

0

0

0

1

1

0

0

*

*

030

1 1

1

0

1

0

0

0

1

1

0

0

*

*

030

1 1

1

1

0

0

0

0

1

1

0

0

*

*

030

1 1

1

1

1

0

0

0

1

1

0

0

*

*

030

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HEXADECIMAL

LABORATORIO DE SISTEMAS DIGITALES I

HXD DE LA 1° MEMORIA

7

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LABORATORIO DE SISTEMAS DIGITALES I

HXD DE LA 2° MEMORIA

8

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LABORATORIO DE SISTEMAS DIGITALES I

SIMULACIÓN EN PROTEUS 8.4

9

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